Arquiteturas e algoritmos para um analisador de interconexões
dc.contributor.advisor | Wagner, Tiaraju Vasconcellos | pt_BR |
dc.contributor.author | Brune, Osmar | pt_BR |
dc.date.accessioned | 2010-09-02T04:18:54Z | pt_BR |
dc.date.issued | 1988 | pt_BR |
dc.identifier.uri | http://hdl.handle.net/10183/25514 | pt_BR |
dc.description.abstract | Este trabalho abor da um e studo de algoritmo s e arquiteturas de um Analisador de Interconexões. Várias alternativas possíveis são discutidas e uma análise de custo e desempenho é feita. Alguns dos algoritmos e arquiteturas propostos parecem ser novos se comparados à literatura publicada. Um dos algoritmos foi completamente simulado para auxiliar a análise de desempenho e para demonstrar a interface com o usuário em uma aplicação comercial. | pt_BR |
dc.description.abstract | This work deals with a study of algorithms and architectures of an Interconnection Analyzer. Several possible alternatives are discussed and an analysis of cost and performance is carried out. Some of the prop osed algorithms and architectures seems to be new when compared to the published literature. One of the algorithms was fully simulated to help the performance analysis and to demonstrate the user interface in a commercial application. | en |
dc.format.mimetype | application/pdf | |
dc.language.iso | por | pt_BR |
dc.rights | Open Access | en |
dc.subject | Microeletrônica | pt_BR |
dc.subject | Roteamento : Circuitos integrados | pt_BR |
dc.subject | Circuitos integrados | pt_BR |
dc.title | Arquiteturas e algoritmos para um analisador de interconexões | pt_BR |
dc.type | Dissertação | pt_BR |
dc.identifier.nrb | 000752971 | pt_BR |
dc.degree.grantor | Universidade Federal do Rio Grande do Sul | pt_BR |
dc.degree.department | Instituto de Informática | pt_BR |
dc.degree.program | Programa de Pós-Graduação em Ciência da Computação (até 1998) | pt_BR |
dc.degree.local | Porto Alegre, BR-RS | pt_BR |
dc.degree.date | 1988 | pt_BR |
dc.degree.level | mestrado | pt_BR |
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