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Navegação Microeletrônica por Título

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      Síntese e passivação de nanofios de óxido de zinco 

      Menezes, Eduardo Serralta Hurtado de (2017) [Dissertação]
      Neste trabalho se realiza a síntese e caracterização de nanofios de óxido de zinco. Adicionalmente se apresenta o processo de montagem de um dispositivo para medidas elétricas deste material. Estuda-se complementarmente o ...
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      Síntese, fotoluminescência e caracterização elétrica de nanoestruturas de ZnO 

      Cauduro, André Luís Fernandes (2012) [Dissertação]
      Nanofios semicondutores de óxido metálico apresentam enorme potencial em aplicações de nano-sensoriamento de diferentes gases e substâncias químicas e biológicas, bem como na aplicação a detectores UV-visível. Neste trabalho, ...
    • Sistema de spray pirólise com movimento horizontal microcontrolado para deposição de filmes finos de TiO2. 

      Granoski, Rafael (2020) [Dissertação]
      Nesta dissertação descrevemos a construção de um equipamento para deposição de filmes finos por spray pirólise para aplicações futuras em fotocatálise. Para demonstrar o funcionamento do equipamento usaremos a deposição ...
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      Sistema de tradução binária de dois níveis para execução multi-ISA 

      Fajardo Junior, Jair (2011) [Dissertação]
      Atualmente, a adição de uma nova função implementada em hardware em um processador não deve impor nenhuma mudança no conjunto de instruções (ISA – Instruction Set Architecture) suportado para atingir melhorias em seu ...
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      Sistemas multiprocessados em chip : reconfigurabilidade e heterogeneidade, economia e compatibilidade binária 

      Silva Junior, Paulo Cesar Santos da (2014) [Dissertação]
      As limitações resultantes do avanço das tecnologias de integração, como o crescente aumento da densidade de potência, levando à necessidade de redução da frequência de operação dos circuitos somados à necessidade de redução ...
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      Soft error analysis with and without operating system 

      Casagrande, Luiz Gustavo (2016) [Dissertação]
      The complexity of integrated system on-chips as well as commercial processor’s architecture has increased dramatically in recent years. Thus, the effort for assessing the susceptibility to faults due to the incidence of ...
    • Static noise margin analysis for CMOS logic cells in near-threshold 

      Bortolon, Felipe Todeschini (2018) [Dissertação]
      The advancement of semiconductor technology enabled the fabrication of devices with faster switching activity and chips with higher integration density. However, these advances are facing new impediments related to energy ...
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      Study of the hysteretic behavior in ZnO nanoparticle thin-film transistors 

      Vidor, Fábio Fedrizzi (2012) [Dissertação]
      Nas últimas décadas, o interesse na eletrônica flexível tem aumentado. Sistemas que apresentam benefícios, tais como: baixo custo, melhor desempenho, transparência, confiabilidade e melhores credenciais ecológicas, estão ...
    • Tackling the drawbacks of a lagrangian relaxation based discrete gate sizing algorithm 

      Plácido, Henrique (2018) [Dissertação]
      The shrink of the devices sizes allows the number of transistors in the integrated circuits to grow, leading to an increase in the leakage power. The discrete gate sizing technique consists in assigning each gate of the ...
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      Técnicas de baixo consumo para módulos de hardware de codificação de vídeo H.264 

      Walter, Fábio Leandro (2011) [Dissertação]
      Este trabalho trata da aplicação de técnicas de minimização de consumo de potência para blocos digitais para o algoritmo de SAD e o decodificador H.264/AVC Intra-Only. Na descrição de hardware são acrescidas as técnicas ...
    • Temperature compensated subthreshold CMOS voltage references for ultra low power applications 

      Oliveira, Arthur Campos de (2017) [Dissertação]
      This work proposes novel temperature-compensated subthreshold voltage references for ultra-low power and ultra-low voltage applications. The core of the proposed circuits is the self-cascode MOSFET (SCM) since it can operate ...
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      Teste de amplificadores diferenciais através de medida DC e transiente de tensões internas de polarização 

      Bender, Isis Duarte (2015) [Dissertação]
      Este trabalho apresenta estudos voltados ao teste de Amplificadores Diferenciais. No primeiro momento, por meio de simulações SPICE, falhas catastróficas são injetadas em dois Amplificadores Diferenciais, projetados para ...
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      The effects of the compiler optimizations in embedded processors reliability 

      Lins, Filipe Maciel (2017) [Dissertação]
      The recent advances in the embedded processors increase the compilers complexity, and the usage of heterogeneous resources such as Field Programmable Gate Array (FPGA) and Graphics Processing Unit (GPU) integrated with the ...
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      Transient-fault robust systems exploiting quasi-delay insensitive asynchronous circuits 

      Bastos, Rodrigo Possamai (2010) [Tese]
      Os circuitos integrados recentes baseados em tecnologias nanoeletrônicas estão significativamente mais vulneráveis a falhas transientes. Os erros gerados são assim também mais críticos do que eram antes. Esta tese apresenta ...
    • Transistor level automatic generation of radiation-hardened circuits 

      Lazzari, Cristiano (2007) [Tese]
      Tecnologias submicrônicas (DSM) têm inserido novos desafios ao projeto de circuitos devido a redução de geometrias, redução na tensão de alimentação, aumento da freqüência e aumento da densidade de lógica. Estas características ...
    • UFRGSPlace : a wirelength driven FPGA placement algorithm 

      Puget, Julia Casarin (2018) [Dissertação]
      FPGAs are semiconductor devices that can be reprogrammed to reach different application requirements after manufacturing. The architecture of an FPGA can be homogeneous, containing only standard blocks of an FPGA, IOs and ...
    • Use of approximate triple modular redundancy for fault tolerance in digital circuits 

      Gomes, Iuri Albandes Cunha (2018) [Tese]
      Triple Modular Redundancy (TMR) is a well-known mitigation technique, which provides a full masking capability to single faults, although at a great cost in terms of area and power consumption. For that reason, partial ...
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      Utilizando folding no projeto de portas lógicas robustas à variabilidade de processo 

      Guex, Jerson Paulo (2013) [Dissertação]
      Este trabalho visa explorar técnicas de projeto de células que possibilitem a minimização dos efeitos da variabilidade de processo sobre o comportamento elétrico dos circuitos integrados. Para este trabalho foram abordados ...
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      VEasy : a tool suite towards the functional verification challenges 

      Pagliarini, Samuel Nascimento (2011) [Tese]
      Esta dissertação descreve um conjunto de ferramentas, VEasy, o qual foi desenvolvido especificamente para auxiliar no processo de Verificação Funcional. VEasy contém quatro módulos principais, os quais realizam tarefas-chave ...
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      Voltage scaling interfaces for multi-voltage digital systems 

      Llanos, Roger Vicente Caputo (2015) [Dissertação]
      Multiple Voltage Digital Systems exploit the concept of voltage scaling by applying different supplies to particular regions of the chip. Each of those regions belongs to a power domain and may have two or more supply ...

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