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dc.contributor.advisorReis, Ricardo Augusto da Luzpt_BR
dc.contributor.authorSilva, Luciana Mendes dapt_BR
dc.date.accessioned2018-07-10T02:33:09Zpt_BR
dc.date.issued2018pt_BR
dc.identifier.urihttp://hdl.handle.net/10183/180291pt_BR
dc.description.abstractNeste trabalho é apresentado um método para redução do número de transistores em circuitos integrados. Foram desenvolvidos um algoritmo e uma ferramenta de EDA baseada no mesmo, denominada de LOMGAM (Logic Minimization by Gate Merging - minimização Lógica por Fusão de Portas), com o objetivo de investigar a redução do número de transistores em um circuito integrado por meio da fusão de portas lógicas. Essa técnica é aplicada sobre uma netlist já mapeado para uma biblioteca de células, e trabalha substituindo conjuntos de portas lógicas interconectadas de fanout unitário por novas portas complexas de função lógica equivalente, independente delas estarem disponíveis em uma biblioteca. A ferramenta desenvolvida, LOMGAM é usada para explorar a aplicação de um conjunto de parâmetros na realização da fusão de portas, e observar o comportamento da aplicação destes sobre o número final de transistores e de conexões do circuito. O LOMGAM é composto por 7 etapas: Identificação das Interconexões e das Portas Combinacionais; Identificação do Fanout; Geração das Equações Booleanas; Processo de Fusão; Conversão para CMOS; Geração da Netlist minimizada no Formato eqn e Geração da netlist no formato Spice O suporte a três tipos de parâmetros de controle foi implementado: Índice de Fusão de Portas (Gate Merging Index - GMI), Quantidade Máxima de Transistores em Série (QTMS), e Número Máximo de Inversores (NMI) nas entradas das portas aglutinadas. Sendo que o usuário pode adotar separadamente pelo uso do GMI ou do QMTS. Através da aplicação do LOMGAM verificou-se uma redução média de 11% no número de transistores e de 26,17%, em média, da quantidade de interconexões para o parâmetro Quantidade Máxima de Transistores em Série (QMTS). Para o parâmetro Índice de Fusão de Portas (GMI), ocorreu uma redução média de 6,89% na quantidade de transistores e uma redução média de 13,31% na quantidade de interconexões. Além disso, observa-se que o tempo de execução da ferramenta não aumenta exponencialmente em relação ao aumento do Índice de Fusão de Portas (GMI).pt_BR
dc.description.abstractIn this work, we introduce a method to reduce the number of transistors in integrated circuits. We have developed an algorithm and an EDA tool based on it, called LOMGAM (Logic Minimization by Gate Merging), they have goal to investigate the reduction of the number of transistors in an integrated circuit by merging logic gate. This technique is applied over a netlist already mapped to a cell library, and it works by replacing interconnected sets of logic gates with unitary fanout for new complex gates with equivalent logic function, regardless of whether they are available in a library. The tool developed, LOMGAM, is used to explore the application of a set of parameters in the realization of the gate merging process, and it observes the behavior of the application of these on the final number of transistors and circuit connections. The LOMGAM is composed of 7 steps: Identification of interconnections and Combinational Gates; Identification of Fanout; Generation of Boolean Equations; Gate Merging Process; Conversion to CMOS Technology; Generation of Optimized Netlist in eqn Format and Generation of Optimized Netlist in Spice Format The support to three types of control parameters were implemented: Gate Merging Index (GMI), Maximum Number of Transistors in Series (QTMS), and Maximum Number of Inverters (NMI) in the inputs of the merged gates. Being that the user can adopt separately by the use of GMI or QMTS. Through the application of LOMGAM, we observe an average reduction of 11 % in the number of transistors and 26.17 %, on average, of the number of interconnections for the parameter Maximum Quantity of Transistors in Series (QMTS). For the parameter Gate Merging Index (GMI), there was an average reduction of 6.89 % in the number of transistors and an average reduction of 13.31 % in the amount of interconnections. In addition, we observed that the execution time of tool does not increase exponentially in relation to the increase of the Gate Merging Index (GMI).en
dc.format.mimetypeapplication/pdf
dc.language.isoporpt_BR
dc.rightsOpen Accessen
dc.subjectMicroeletrônicapt_BR
dc.subjectLogic minimizationen
dc.subjectMicroelectronicsen
dc.subjectCircuitos integradospt_BR
dc.subjectEDAen
dc.subjectAlgorithmen
dc.titleMinimização lógica por fusão de portaspt_BR
dc.title.alternativeLogic minimization by gate merging en
dc.typeDissertaçãopt_BR
dc.contributor.advisor-coAlves, Guilherme Bontorinpt_BR
dc.identifier.nrb001070201pt_BR
dc.degree.grantorUniversidade Federal do Rio Grande do Sulpt_BR
dc.degree.departmentInstituto de Informáticapt_BR
dc.degree.programPrograma de Pós-Graduação em Microeletrônicapt_BR
dc.degree.localPorto Alegre, BR-RSpt_BR
dc.degree.date2018pt_BR
dc.degree.levelmestradopt_BR


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